原理图/PCB 已在 EasyEDA 里做到 12 页跨页 0 漏接,固件刚完成骨架包 A1。 这次是把已有的一切一次性纳入版本控制,没有改动任何设计内容。 纳入: - 设计与需求文档、PROGRESS.md、小米8 参考原理图 PDF 与追脚脚本 - .claude/ 下的 EasyEDA 桥接工具链与几何/网表缓存(eda-parts.json、 pcb-parts.json、pcb-pads.json、p2-ch1.json 等,是重画各页的唯一事实来源) - 117 张验证截图(本项目所有方向问题都是靠人眼看截图发现的,属于证据不是垃圾) - firmware/ 的 A1 骨架与 site/ 文档站源码 .gitignore 排除:构建产物(firmware/build、host/build、sdkconfig)、 site/node_modules、__pycache__、桥接日志 _bridge.log、脚本自标的 *.stale。 .gitattributes 默认 `* -text`:现有 .py/.json 大多是 CRLF,原样存, 不让 git 重写行尾。唯一例外是 *.sh 强制 LF —— 带 \r 的 shell 脚本 bash 跑不了。 Co-Authored-By: Claude Opus 5 <[email protected]> Claude-Session: https://claude.ai/code/session_01QYuExfgyYa6DzRRcUso8M8
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await eda.dmt_EditorControl.openDocument('9a6096762e036e23');
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await new Promise(r => setTimeout(r, 1500));
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const M = 10; // sch 单位 -> 记录原样
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const out = {};
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// U13 的引脚
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for (const c of await eda.sch_PrimitiveComponent.getAll()) {
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if ((c.designator || '') !== 'U13') continue;
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out.u13 = {x: c.x, y: c.y, rot: c.rotation};
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const pins = await eda.sch_PrimitiveComponent.getAllPinsByPrimitiveId(c.primitiveId);
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out.pins = pins.map(p => ({n: p.pinNumber, name: p.pinName, x: p.pinDotX, y: p.pinDotY}));
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}
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// 附近的导线与端口
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const near = (x, y) => out.u13 && Math.abs(x - out.u13.x) < 200 && Math.abs(y - out.u13.y) < 200;
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out.wires = (await eda.sch_PrimitiveWire.getAll())
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.filter(w => Array.isArray(w.points) && w.points.some((v,i) => i%2===0 && near(v, w.points[i+1])))
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.map(w => ({pts: w.points}));
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out.ports = [];
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for (const t of ['sch_PrimitiveNetPort', 'sch_PrimitiveNetFlag', 'sch_PrimitiveNetLabel']) {
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if (!eda[t]) continue;
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try {
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const all = await eda[t].getAll();
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for (const p of all) if (near(p.x, p.y)) out.ports.push({t, name: p.name || p.netName || p.text, x: p.x, y: p.y, rot: p.rotation});
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} catch (e) { out.ports.push({t, err: String(e).slice(0,80)}); }
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}
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return out;
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