zhou yang和Claude Opus 5
2bfe308b30
原理图/PCB 已在 EasyEDA 里做到 12 页跨页 0 漏接，固件刚完成骨架包 A1。 这次是把已有的一切一次性纳入版本控制，没有改动任何设计内容。 纳入： - 设计与需求文档、PROGRESS.md、小米8 参考原理图 PDF 与追脚脚本 - .claude/ 下的 EasyEDA 桥接工具链与几何/网表缓存（eda-parts.json、 pcb-parts.json、pcb-pads.json、p2-ch1.json 等，是重画各页的唯一事实来源） - 117 张验证截图（本项目所有方向问题都是靠人眼看截图发现的，属于证据不是垃圾） - firmware/ 的 A1 骨架与 site/ 文档站源码 .gitignore 排除：构建产物（firmware/build、host/build、sdkconfig）、 site/node_modules、__pycache__、桥接日志 _bridge.log、脚本自标的 *.stale。 .gitattributes 默认 `* -text`：现有 .py/.json 大多是 CRLF，原样存， 不让 git 重写行尾。唯一例外是 *.sh 强制 LF —— 带 \r 的 shell 脚本 bash 跑不了。 Co-Authored-By: Claude Opus 5 <[email protected]> Claude-Session: https://claude.ai/code/session_01QYuExfgyYa6DzRRcUso8M8
505 行
25 KiB
Python
505 行
25 KiB
Python
# -*- coding: utf-8 -*-
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u"""PhoneRail 的铺铜/平面层模型 —— 事实来源，改铜面改这里再 --push。
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/c/Python314/python .claude/pcb_pour.py [--push] [--only L2|L3]
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## 叠层（§10.1，layerStatus=1 的正好这四层）
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| 设计文档 | EasyEDA 层 | id | 这里干什么 |
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|---|---|---|---|
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| L1 | Top Layer | 1 | 功率器件 + 信号，**D± 走这层，以 L2 为参考面** |
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| L2 | Inner1-GND | 15 | **完整地平面，不许割断**（§10.1）|
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| L3 | Inner2-PWR | 16 | 12V 母线 + 5V + 3V3 + 五路输出，**分割灌铜** |
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| L4 | Bottom Layer | 2 | 控制信号 + ESP32 |
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## 板框
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160 × 125 mm，四角 R5（圆心正好落在四个 M3 定位孔的中心 (5,5)/(155,5)/(5,120)/(155,120)）。
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⚠️ **API 枚举不到那四段圆弧**：`pcb_PrimitiveArc.getAll()` 和 `getAllPrimitiveId()`
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都返回 0，layer 11 上全工程只有 4 条直线（端点恰好是 R5 的切点）。
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但渲染上角是实实在在的圆弧、闭合的。所以这里**不去读板框，按几何自己造多边形**。
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（打样前记得用 Gerber 预览复核一次板框闭合。）
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## 多边形不闭合就建不出来，而且 `create()` 成功了也会抛 ⚠️⚠️
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两个坑叠在一起，实测（2026-09-03）：
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1. **`TPCB_PolygonSourceArray` 必须显式闭合** —— 末尾要把首点再写一遍。
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文档写着「如果首尾不重合将会自动重合」，**对铺铜边框不成立**：
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不闭合时 `pcb_PrimitivePour.create()` 直接不建，板上一块铜面都不多。
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（`board_poly()` 一直能用，是因为它最后那段圆弧正好回到起点。）
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2. **`create()` 抛异常不等于失败。** 闭合的多边形建得出来，
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但调用照样抛 `错误：无法创建覆铜边框图元，可能是传入的参数不正确。`
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—— 所以**返回值和 try/catch 都不能当判据**，只能建完 `getAll()` 按名字核对。
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顺带一提：**铺铜名字会被 EasyEDA 转成大写**，比对时要 `toUpperCase()`。
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一次分不清这两个的排查过程：不闭合的矩形（PA-OPEN）建完 `getAll()` 数量不变，
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闭合的（PB-CLOSE）数量 +1 —— 两者都抛了一模一样的异常。
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## 填充只能点菜单，`rebuildCopperRegion()` 是坏的 ⚠️
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`pcb_PrimitivePour.create()` 建出来的只是**铺铜边框**（`nPour` 会 +1），
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里头一片铜都没有，`pcb_PrimitivePoured.getAll()` 仍是 0，网络也不算连通。
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`IPCB_PrimitivePour.rebuildCopperRegion()`（文档标 BETA）**必然抛**
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`TypeError: Cannot read properties of undefined (reading 'length')`，约 157 ms。
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四种写法都试过、都一样：`getAll()` 拿回来的对象、`toAsync()/done()` 异步式、
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`createPolygon` 建的、`createComplexPolygon` 建的。
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唯一能用的路子是 GUI：**工具 → 铺铜管理器... → 重建所有 → 确认**。
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本文件的 `--push` 已经把这一串用 React 的 `onClick` 打进去了
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（菜单项是 React 元素，用 `__reactProps$*.onClick`；`重建所有` 是原生 `<button>`，
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两种都试，见 `drc_read.py` 的注释）。
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**判据是 `nPoured`，不是 `nPour`。** 2026-09-03 实测：GND-L2 一块铜面重建耗时 < 2 s，
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重建之后 DRC 的连接性错误从 1467 掉到 925。
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## ⚠️ 本文件里的「优先级」那一列是**错的**，只是这块板上不要紧（2026-09-05 查清）
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`plan()` 给 GND 1、给电源岛 5，隐含「数字大 = 优先」。**反了。**
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铺铜管理器对话框自己写着「重建多个铺铜时，系统将按照优先级数字**从小到大**来执行铺铜」——
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先铺的占地盘，所以 **GND 底填要给最大的数字**。
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这块板上没出事，是因为这 19 块铜面**同层从不重叠**（`audit()` 的 MIN_GAP 就是在保这一条），
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优先级压根没参与裁剪。**抄到载板去之前必须先把这一位翻过来**（载板 Inner1 是
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分割电源面 + GND 底填，全靠优先级互相裁）。
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顺带：`create()` 的第 7 个参数 `pourPriority` **不生效** —— 传进去的值被忽略，
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实测这 14 块回读的是 1,2,3,4,4,5,5,6,7,8,9,10,11,12（基本是创建顺序）。
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真要控制优先级只能建完再 `setState_PourPriority()` 逐块设并回读核对。见 skill §9j。
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## ESP32 天线禁铺区
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U20 在 (143, 46)、rot=270，本体框（rot=0）是 (-9.5, -9.35, 9.5, 16.75) ——
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焊盘只在三面，**天线那一端(+Y)没有焊盘**，本体比焊盘框多伸 7.4 mm。
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rot=270 之后天线朝 **+X**，落在 x≈152~160、y≈36.5~55.5。
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模组 datasheet 要求**所有层**在天线下方都不铺铜，所以每一层的多边形都要挖这个缺口。
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缺口开到右板边，不会把地平面割成两块（§10.1 那条「不许割断」仍然满足）。
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"""
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import io, json, os, sys
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HERE = os.path.dirname(os.path.abspath(__file__))
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sys.path.insert(0, HERE)
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from eda import run
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PCB = '7e9415a16a909c51'
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MIL = 39.3701
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L_TOP, L_GND, L_PWR, L_BOT = 1, 15, 16, 2
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BOARD = (0.0, 0.0, 160.0, 125.0)
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R_CORNER = 5.0
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INSET = 0.5 # 铜面离板边
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# 天线禁铺（含 1 mm 余量），x 一直开到板边
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ANT = (151.0, 35.5, 160.0, 56.5)
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def board_poly(inset=INSET, notch=ANT):
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u"""板框内缩 inset 的圆角矩形，右边挖掉天线缺口。
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返回 TPCB_PolygonSourceArray（mil）：
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x1 y1 'L' x2 y2 ... 'ARC' 角度 ex ey ...
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ARC 的起点是「当前点」，角度正值逆时针（本工程 y 轴朝上）。
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"""
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x0, y0, x1, y1 = BOARD
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d = inset
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r = R_CORNER - d # 圆心不变，半径跟着缩
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cx0, cy0, cx1, cy1 = x0 + R_CORNER, y0 + R_CORNER, x1 - R_CORNER, y1 - R_CORNER
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ny0, ny1 = notch[1], notch[3]
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nx = notch[0]
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pts = [] # (mode, ...) 顺序即绘制顺序，逆时针
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def L(x, y):
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pts.append(('L', x, y))
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def A(x, y):
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pts.append(('ARC', 90.0, x, y))
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start = (cx0, y0 + d) # 底边左端切点
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L(cx1, y0 + d) # 底边 →
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A(x1 - d, cy0) # 右下角圆弧
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L(x1 - d, ny0) # 右边 ↑ 到缺口下沿
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L(nx, ny0) # 缺口 ←
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L(nx, ny1) # 缺口 ↑
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L(x1 - d, ny1) # 缺口 →
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L(x1 - d, cy1) # 右边 ↑
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A(cx1, y1 - d) # 右上角
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L(cx0, y1 - d) # 顶边 ←
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A(x0 + d, cy1) # 左上角
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L(x0 + d, cy0) # 左边 ↓
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A(cx0, y0 + d) # 左下角，回到起点
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src = [start[0] * MIL, start[1] * MIL]
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mode = None
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for p in pts:
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if p[0] == 'L':
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if mode != 'L':
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src.append('L'); mode = 'L'
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src += [p[1] * MIL, p[2] * MIL]
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else:
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src.append('ARC'); mode = 'ARC'
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src += [p[1], p[2] * MIL, p[3] * MIL]
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return src
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def poly_from_pts(pts):
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u"""任意直边多边形 -> TPCB_PolygonSourceArray（mil）。pts 是 [(x, y), ...] mm。
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⚠️ **末尾必须把首点再写一遍**，见文件头「多边形不闭合就建不出来」。
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"""
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src = [pts[0][0] * MIL, pts[0][1] * MIL, 'L']
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for x, y in list(pts[1:]) + [pts[0]]:
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src += [x * MIL, y * MIL]
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return src
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def rect(x0, y0, x1, y1):
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return poly_from_pts([(x0, y0), (x1, y0), (x1, y1), (x0, y1)])
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def lshape(bx, by, tx, ty, ax, ay):
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u"""主矩形 (bx,by)-(tx,ty) 左边再挂一块 (ax,ay)-(bx,ty) 的臂。"""
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return poly_from_pts([(bx, by), (tx, by), (tx, ty), (ax, ty), (ax, ay), (bx, ay)])
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# ── 要建的铜面 ─────────────────────────────────────────────────────────
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# name, net, layer, 多边形, 优先级
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# ══ L3（Inner2-PWR）══════════════════════════════════════════════════════
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# 水平分层，和 L1 上器件的分带一一对应，过孔就都是最短的：
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#
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# y 110.0~116.2 VOn_P 五路输出到手机（在 **L4**，见下）
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# y 82.5~ 99.5 VOn 电感 + 输出电容 + eFuse 输入侧（顺带给 eFuse 铺散热铜）
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# y 67.5~ 81.9 +12V 五路 Buck 的输入母线（横贯整板）
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# y 33.0~ 67.5 +12V band B 的支路 + 母线源头（x 38.5~95）
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# y 49.0~ 66.5 $1N236 Q1 输出 → 体电容 → MLCC → Rs6 上游（x 14.4~35）
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# y 49.5~ 56.5 $1N227 F1 → Q1 输入（x 14.6~19.0）
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# y 45.5~ 55.5 $1N223 J1 → F1（x 3~14）
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#
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# ⚠️ 分界线的位置是**焊盘边**定的，不是整数好看：
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# +12V 顶边 81.9 —— 再高就撞 C102 那一排 1210 的 +12V 焊盘（y 80.2~81.7）；
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# VOn 底边 82.3 —— C107 pin1 是 rot90 的 1210，焊盘竟然跨到 y 83.07~84.55，
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# 比元件中心低 1.6 mm。按"元件在 y85.4"算会把它漏在两块铜面之间的缝里。
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#
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# ⚠️ **U8 / U13 三个 Kelvin 脚一律不进铜面**（MSOP-10，0.5 mm 间距）。
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# U13.10 是 VIN+($1N236)、U13.9 是 VIN−(+12V)，两脚相距 0.5 mm ——
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# 任何一条分界线都塞不进去。它们走顶层细线，本来 Kelvin 就不该载流。
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# 所以 $1N236 右边界停在 x35.0、+12V 左边界从 x38.5 起，中间 3.5 mm 全让给它们。
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#
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# ══ L4（Bottom）══════════════════════════════════════════════════════════
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# 五路 VOn_P（Rs 下游 → J2）借用连接器带那条空走廊。这一层是 1 oz，
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# 4 A 只要 1.34 mm，给了 6.2 mm 宽还带一条下伸的臂去接分流电阻。
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# y 上限卡在 116.2 是被 (5,120)/(155,120) 那两个 M3 定位孔逼的：
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# Φ6.0 焊盘 + 0.2 间距 = 铜面要离孔心 3.2 mm 以上，116.2 刚好剩 3.8 mm。
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CH_X0, CH_PITCH = 1.0, 32.0 # 每路铜面的左边界与节距
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CH_W_POUR = 30.0 # 铜面宽度（留 2 mm 路间隙）
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def plan():
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out = [
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(u'GND-L2', 'GND', L_GND, board_poly(), 1),
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# 8 A 输入链，三段各自一块（都很短，宽度按"横向电流的截面 = y 跨度"算）
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(u'VIN-RAW-L3', '$1N223', L_PWR, rect(3.0, 45.5, 14.0, 55.5), 5),
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(u'VIN-FUSED-L3', '$1N227', L_PWR, rect(14.6, 49.5, 19.0, 56.5), 5),
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||
(u'VIN-SW-L3', '$1N236', L_PWR, lshape(19.5, 49.0, 35.0, 66.5, 14.4, 58.5), 5),
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# +12V 母线：band A 横贯 + band B 一块（源头 Rs6 在 x40）
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# 三段：下带 x14.6~95 y33~48.3（去接 U30 的 VIN，它在 x18.6~26.7）、
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# 中带 x38.5~95 y48.3~67.5（源头 Rs6.2 在 x40.07）、顶带横贯全板 y67.5~81.9。
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# 下带左边界 14.6 是被 $1N223 那块（x3~14）逼的，留 0.6 mm。
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(u'12V-L3', '+12V', L_PWR,
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poly_from_pts([(14.6, 33.0), (95.0, 33.0), (95.0, 67.5), (158.0, 67.5),
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(158.0, 81.9), (1.0, 81.9), (1.0, 67.5), (38.5, 67.5),
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||
(38.5, 48.3), (14.6, 48.3)]), 2),
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# ── 三条低压轨（2026-09-04 加）─────────────────────────────────
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# 加之前它们靠细线连，`+3V3` 8 条、`+3V3_HUB` 5 条自动布线器没布通。
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# 都放 L3，塞进 12V 那几条带子中间的空地，互相与 12V 都留 >= 0.5 mm。
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#
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# +5V：U24~U28 五个 VBUS 负载开关排在 y11.5~12 那一行，最坏 2.8 A（§9.4）。
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# 只做 y5.5~14 这一条横带；U30 输出那几个焊盘在 y41~45.5，
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# 被 12V 下带（y33~48.3）占着，进不来，仍走顶层粗线下来接这条带。
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(u'5V-L3', '+5V', L_PWR, rect(11.0, 5.5, 151.0, 14.0), 3),
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# +3V3_HUB：USB2517 + U31 LDO 那一坨，x59~111 / y15~31 正好是它们的地盘。
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# ⚠️ 与 +5V 在 y 上错开（14.0 / 15.0，净空 1 mm）—— 这一带两个网络的焊盘
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# 是交错的（U31 的进/出脚挨着），靠 y 分层比靠 x 分区干净。
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(u'3V3HUB-L3', '+3V3_HUB', L_PWR, rect(59.0, 15.0, 111.0, 31.0), 3),
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# +3V3 分两块（同一个网络两块铜面，靠已有走线连起来）：
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# 控制区 —— 12V 下带/中带的右边（x>95）那块空地，ESP32 / PCA9555 / 595 / DAC 都在这里。
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# ⚠️ 右边界 150.5 是被 ESP32 天线禁铺区（x>=151）逼的，不能再往右。
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||
(u'3V3-CTRL-L3', '+3V3', L_PWR, rect(95.5, 33.5, 150.5, 67.0), 3),
|
||
# 通道区 —— VOn 铜面（y82.5~99.5）之上那一片，六片 INA226 的电源脚都在 y100~105。
|
||
(u'3V3-CH-L3', '+3V3', L_PWR, rect(5.0, 100.3, 155.0, 124.0), 3),
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||
]
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for n in range(1, 6):
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x0 = CH_X0 + (n - 1) * CH_PITCH
|
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x1 = x0 + CH_W_POUR
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out.append((u'VO%d-L3' % n, 'VO%d' % n, L_PWR, rect(x0, 82.5, x1, 99.5), 4))
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||
# VOn_P 在 L4：连接器带 + 一条下伸到分流电阻上游焊盘的臂
|
||
out.append((u'VO%d_P-L4' % n, 'VO%d_P' % n, L_BOT,
|
||
poly_from_pts([(x0, 104.5), (x0 + 3.5, 104.5), (x0 + 3.5, 110.0),
|
||
(x1, 110.0), (x1, 116.2), (x0, 116.2)]), 4))
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return out
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||
# ── 本地检查（不连 EasyEDA）───────────────────────────────────────────────
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def _poly_pts(src):
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u"""把 TPCB_PolygonSourceArray 还原成 mm 的顶点表。只处理直边（本文件的 L3/L4 都是）。"""
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pts, i = [], 0
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while i < len(src):
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v = src[i]
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if v == 'L':
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i += 1; continue
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if v == 'ARC':
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||
i += 4; continue # 板框那块有弧，这里只用来算包围盒
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pts.append((src[i] / MIL, src[i + 1] / MIL)); i += 2
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return pts
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||
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||
def _inside(px, py, pts):
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||
u"""射线法。边界上算在里面（本文件的分界线都留了 >= 0.4 mm 净空，不会踩边界）。"""
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n, inside = len(pts), False
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j = n - 1
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||
for i in range(n):
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||
xi, yi = pts[i]; xj, yj = pts[j]
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||
if (yi > py) != (yj > py) and px < (xj - xi) * (py - yi) / (yj - yi + 1e-30) + xi:
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||
inside = not inside
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j = i
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return inside
|
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|
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def _bbox(pts):
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xs = [p[0] for p in pts]; ys = [p[1] for p in pts]
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||
return min(xs), min(ys), max(xs), max(ys)
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MIN_GAP = 0.4 # 同层两块铜面之间的最小净空（安全间距 0.2 的两倍，留余量）
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def _seg_dist(p, q, r, t):
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||
u"""两条线段的最短距离。相交返回 0。"""
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||
def d_pt_seg(px, py, ax, ay, bx, by):
|
||
dx, dy = bx - ax, by - ay
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||
L2 = dx * dx + dy * dy
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||
s = 0.0 if L2 == 0 else max(0.0, min(1.0, ((px - ax) * dx + (py - ay) * dy) / L2))
|
||
return ((px - ax - s * dx) ** 2 + (py - ay - s * dy) ** 2) ** 0.5
|
||
|
||
def cross(o, a, b):
|
||
return (a[0] - o[0]) * (b[1] - o[1]) - (a[1] - o[1]) * (b[0] - o[0])
|
||
d1, d2 = cross(r, t, p), cross(r, t, q)
|
||
d3, d4 = cross(p, q, r), cross(p, q, t)
|
||
if ((d1 > 0) != (d2 > 0)) and ((d3 > 0) != (d4 > 0)):
|
||
return 0.0
|
||
return min(d_pt_seg(p[0], p[1], r[0], r[1], t[0], t[1]),
|
||
d_pt_seg(q[0], q[1], r[0], r[1], t[0], t[1]),
|
||
d_pt_seg(r[0], r[1], p[0], p[1], q[0], q[1]),
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d_pt_seg(t[0], t[1], p[0], p[1], q[0], q[1]))
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def _poly_gap(A, B):
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u"""两个简单多边形的最近距离；一个包含另一个或相交时返回 0。"""
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if any(_inside(x, y, B) for x, y in A) or any(_inside(x, y, A) for x, y in B):
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return 0.0
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best = 1e9
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for i in range(len(A)):
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for j in range(len(B)):
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best = min(best, _seg_dist(A[i], A[(i + 1) % len(A)],
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B[j], B[(j + 1) % len(B)]))
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return best
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# 故意不进铜面的焊盘（后缀匹配位号）。漏在这张表以外的都要查。
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# U8/U13 的 0.5 mm 间距 Kelvin 脚 —— 分界线塞不进去，本来也不载流
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# DZ1/C1 —— Q1 的栅极钳位，接的是 $1N227 但只有 µA 级
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# R%01 —— VOn 的反馈分压抽头，落在 +12V 顶带里，走顶层细线
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# R%19 —— 输出泄放 2512，只有放电脉冲电流
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# 这两条轨的铜面**故意只盖一部分**：它们的焊盘散布全板，铜面只占 12V 带子之间的空地，
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# 其余焊盘靠走线接过来。所以别把「漏掉」当错报，只报个数。
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POUR_PARTIAL = ('+5V', '+3V3')
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EXPECT_OUT = ('U8.', 'U9.', 'U10.', 'U11.', 'U12.', 'U13.', 'DZ1.', 'C1.1', 'R101.', 'R201.', 'R301.', 'R401.', 'R501.',
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'R119.', 'R219.', 'R319.', 'R419.', 'R519.')
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def audit():
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u"""铜面之间不许挨太近；每个网络的焊盘要么在自己的铜面里，要么得记在案。"""
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import collections
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dump = os.path.join(HERE, 'pcb-copper.json')
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pads = json.load(io.open(dump, encoding='utf-8'))['pads'] if os.path.exists(dump) else []
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by_net = collections.defaultdict(list)
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for q in pads:
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by_net[q['net']].append(q)
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ps = [(n, net, l, _poly_pts(src), pr) for n, net, l, src, pr in plan()]
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bad = 0
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# 1) 同层铜面不许挨得太近。
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# ⚠️ 不能用包围盒 —— 12V-L3 是个横跨全板的 L 形，它的包围盒把 band B 全套进去，
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# 四块输入链铜面全被误报成"重叠 -32 mm"。必须逐边算真距离。
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for i in range(len(ps)):
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for j in range(i + 1, len(ps)):
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a, b = ps[i], ps[j]
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if a[2] != b[2]:
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continue
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d = _poly_gap(a[3], b[3])
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if d < MIN_GAP:
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print(u' !! %s 与 %s 同在 layer %d，最近处只有 %.2f mm（要求 >= %.1f）'
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% (a[0], b[0], a[2], d, MIN_GAP))
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bad += 1
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# 2) 每块铜面盖住了本网络的几个焊盘 / 漏了哪些
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print(u'')
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print(u'%-14s %-9s %s' % (u'铜面', u'网络', u'本网焊盘 在内/总数（漏掉的要走顶层线）'))
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# ⚠️ 一个网络可能有**多块**铜面（+3V3 就是两块）。判「焊盘在不在铜面里」
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# 必须拿同网络所有铜面做并集，否则每一块都会把另一块盖住的焊盘报成意外漏掉。
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same_net = {}
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for _n, _net, _l, _pts, _p in ps:
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same_net.setdefault(_net, []).append(_pts)
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for name, net, layer, pts, prio in ps:
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if net == 'GND':
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continue
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mine = by_net.get(net, [])
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ins = [q for q in mine
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if any(_inside(q['x'], q['y'], t) for t in same_net[net])]
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out = [q for q in mine if q not in ins]
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tags = ['%s.%s' % (q['des'] or '?', q['num']) for q in out]
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odd = ([] if net in POUR_PARTIAL else
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[t for t in tags if not t.startswith(EXPECT_OUT) and not t.startswith('?.')])
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note = u''
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if tags:
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note = (u' %d 个在铜面外，走线接（本网铜面只盖一部分）' % len(tags)
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if net in POUR_PARTIAL else u' 漏 %d（预期之内）' % len(tags))
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if odd:
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note = u' !! 意外漏掉: ' + ' '.join(odd[:8])
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bad += 1
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print(u'%-14s %-9s %d / %d%s' % (name, net, len(ins), len(mine), note))
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if not mine:
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# ⚠️ 多半是 $1N223 这类**自动命名**的网络改了号（原理图一重新生成网表就会变）。
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# pcb_fanout.py 的 TARGET 里也有同样三个名字，要一起改。
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print(u' !! 板上根本没有这个网络 —— 自动命名的网络改号了？')
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bad += 1
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elif not ins:
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print(u' !! 一个都没盖住 —— 网络名或坐标错了')
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bad += 1
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print(u'')
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print(u'铜面 %d 块，问题 %d 条' % (len(ps), bad))
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return bad
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OPEN = u"""
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await eda.dmt_EditorControl.openDocument('%s');
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await new Promise(r => setTimeout(r, 1200));
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""" % PCB
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# ⚠️ 桥接单次请求 30 s 就超时（skill §9c）。15 块铜面 + 重建全部远超这个数，
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# 所以拆成四步，每一步都短：建（分批）→ 点重建 → 轮询 → 确认+存盘。
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JS_DEL = OPEN + u"""
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let n = 0;
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for (const old of await eda.pcb_PrimitivePour.getAll()) { await eda.pcb_PrimitivePour.delete(old.primitiveId); n++; }
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return {deleted: n};
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"""
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JS_MAKE = OPEN + u"""
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const PLAN = %s;
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for (const p of PLAN) {
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const poly = await eda.pcb_MathPolygon.createComplexPolygon([p.src]);
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if (!poly) continue;
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// ⚠️ create() **成功了也会抛**（见文件头），返回值和 try/catch 都不能当判据
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try { await eda.pcb_PrimitivePour.create(p.net, p.layer, poly, 'solid', false, p.name, p.prio, 10); }
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catch (e) {}
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}
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const made = (await eda.pcb_PrimitivePour.getAll()).map(x => String(x.pourName || '').toUpperCase());
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return {made};
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"""
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# 工具 → 铺铜管理器... → 重建所有（React 元素用 __reactProps$*.onClick，按钮用原生 click）
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JS_REBUILD = OPEN + u"""
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const sleep = ms => new Promise(r => setTimeout(r, ms));
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||
const propsOf = el => { for (const k of Object.keys(el)) if (k.startsWith('__reactProps$')) return el[k]; return null; };
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||
const fire = (el) => { let t = el; for (let i=0;i<8&&t;i++){const q=propsOf(t);
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||
if(q&&typeof q.onClick==='function'){q.onClick({target:t,currentTarget:t,stopPropagation(){},preventDefault(){},nativeEvent:{},button:0,detail:1});return true;} t=t.parentElement;} return false; };
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||
const leaf = (txt) => { for (const el of document.querySelectorAll('*'))
|
||
if (el.children.length===0 && (el.textContent||'').trim()===txt) return el; return null; };
|
||
const btn = (txt) => { for (const b of document.querySelectorAll('button'))
|
||
if ((b.innerText||'').trim()===txt && b.offsetParent!==null) return b; return null; };
|
||
if (!fire(leaf('工具'))) return {err: 'no 工具'};
|
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await sleep(900);
|
||
if (!fire(leaf('铺铜管理器...'))) return {err: 'no 铺铜管理器'};
|
||
await sleep(2200);
|
||
const b = btn('重建所有');
|
||
if (!b) return {err: 'no 重建所有'};
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||
return {fired: fire(b)};
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||
"""
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||
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||
JS_POLL = u"return {poured: (await eda.pcb_PrimitivePoured.getAll()).length};"
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||
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||
JS_DONE = u"""
|
||
const propsOf = el => { for (const k of Object.keys(el)) if (k.startsWith('__reactProps$')) return el[k]; return null; };
|
||
const fire = (el) => { let t = el; for (let i=0;i<8&&t;i++){const q=propsOf(t);
|
||
if(q&&typeof q.onClick==='function'){q.onClick({target:t,currentTarget:t,stopPropagation(){},preventDefault(){},nativeEvent:{},button:0,detail:1});return true;} t=t.parentElement;} return false; };
|
||
let ok = null;
|
||
for (const b of document.querySelectorAll('button'))
|
||
if ((b.innerText||'').trim()==='确认' && b.offsetParent!==null) { ok = b; break; }
|
||
if (ok) fire(ok);
|
||
await new Promise(r => setTimeout(r, 1200));
|
||
await eda.pcb_Document.save();
|
||
return {poured: (await eda.pcb_PrimitivePoured.getAll()).length,
|
||
pour: (await eda.pcb_PrimitivePour.getAll()).length};
|
||
"""
|
||
|
||
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def main():
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ps = plan()
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print(u'计划建 %d 块铜面：' % len(ps))
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for name, net, layer, src, prio in ps:
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n_arc = sum(1 for v in src if v == 'ARC')
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n_pt = sum(1 for v in src if isinstance(v, float)) // 2
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print(u' %-10s net=%-6s layer=%-3d 多边形 %d 点 / %d 段弧'
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% (name, net, layer, n_pt, n_arc))
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||
audit()
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||
if '--push' not in sys.argv and '--rebuild' not in sys.argv:
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print(u'（未加 --push，没有下发）')
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||
return
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def call(js, timeout=60):
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r = run(js, timeout=timeout)
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if not r.get('success'):
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print(u'失败:', json.dumps(r, ensure_ascii=False)[:400]); sys.exit(1)
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return r['result']
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||
print(u'')
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if '--rebuild' in sys.argv:
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||
# 铜面本身没变，只是扇出改了 -> 只重填，别重建边框
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made = [n.upper() for n, _, _, _, _ in ps]
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||
else:
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print(u'清掉旧铜面:', call(JS_DEL)['deleted'], u'块')
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||
for k in ([] if '--rebuild' in sys.argv else range(0, len(ps), 5)): # 5 块一批，稳在 30 s 以内
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||
batch = [{'name': n, 'net': net, 'layer': l, 'src': src, 'prio': pr}
|
||
for n, net, l, src, pr in ps[k:k + 5]]
|
||
made = call(JS_MAKE % json.dumps(batch, ensure_ascii=False))['made']
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||
print(u' 已建 %d / %d' % (len(made), len(ps)))
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||
miss = [n for n, _, _, _, _ in ps if n.upper() not in made]
|
||
if miss:
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||
print(u'!! 这几块没建出来:', ' '.join(miss)); sys.exit(1)
|
||
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r = call(JS_REBUILD)
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||
if r.get('err'):
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print(u'!! 打不开铺铜管理器:', r['err']); sys.exit(1)
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import time
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for i in range(40): # 最多等 ~200 s
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time.sleep(5)
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||
n = call(JS_POLL, timeout=30)['poured']
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||
print(u' 填充 %d / %d' % (n, len(ps)))
|
||
if n >= len(ps):
|
||
break
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d = call(JS_DONE)
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||
print(u'完成：铜面 %d 块，已填充 %d 块' % (d['pour'], d['poured']))
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||
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||
|
||
if __name__ == '__main__':
|
||
main()
|