zhou yang和Claude Opus 5
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原理图/PCB 已在 EasyEDA 里做到 12 页跨页 0 漏接，固件刚完成骨架包 A1。 这次是把已有的一切一次性纳入版本控制，没有改动任何设计内容。 纳入： - 设计与需求文档、PROGRESS.md、小米8 参考原理图 PDF 与追脚脚本 - .claude/ 下的 EasyEDA 桥接工具链与几何/网表缓存（eda-parts.json、 pcb-parts.json、pcb-pads.json、p2-ch1.json 等，是重画各页的唯一事实来源） - 117 张验证截图（本项目所有方向问题都是靠人眼看截图发现的，属于证据不是垃圾） - firmware/ 的 A1 骨架与 site/ 文档站源码 .gitignore 排除：构建产物（firmware/build、host/build、sdkconfig）、 site/node_modules、__pycache__、桥接日志 _bridge.log、脚本自标的 *.stale。 .gitattributes 默认 `* -text`：现有 .py/.json 大多是 CRLF，原样存， 不让 git 重写行尾。唯一例外是 *.sh 强制 LF —— 带 \r 的 shell 脚本 bash 跑不了。 Co-Authored-By: Claude Opus 5 <[email protected]> Claude-Session: https://claude.ai/code/session_01QYuExfgyYa6DzRRcUso8M8
19 行
831 B
JavaScript
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const NETS = ['+5V','+3V3','+3V3_HUB'];
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const out = {};
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for (const n of NETS) out[n] = [];
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const comps = {};
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for (const c of await eda.pcb_PrimitiveComponent.getAll()) comps[c.getState_PrimitiveId()] = c.getState_Designator();
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for (const p of await eda.pcb_PrimitivePad.getAll()) {
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const n = p.getState_Net();
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if (!NETS.includes(n)) continue;
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let des='?'; try { const pid=p.getState_ParentComponentPrimitiveId(); if(pid) des = comps[pid]||'?'; } catch(e){}
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out[n].push([des, p.getState_PadNumber(), Math.round(p.getState_X()/39.3701*100)/100, Math.round(p.getState_Y()/39.3701*100)/100]);
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}
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const sum = {};
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for (const n of NETS) {
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const a = out[n];
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const xs=a.map(v=>v[2]), ys=a.map(v=>v[3]);
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sum[n] = {n:a.length, x:[Math.min(...xs),Math.max(...xs)], y:[Math.min(...ys),Math.max(...ys)]};
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}
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return {sum, pads: out};
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